作者 主题:如何自动更正多个违规? (Read 1705 times)

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离线 尼莫

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如何自动更正多个违规?
« on: 2013年8月30日,上午03:28:12»
你好,

我刚刚完成了使用大型FPGA的处理板的设计,几天前将Gerber发送给了制造公司。

今天,我收到他们的回应,说未达到最小线迹宽度/间隙要求,因此他们无法制造该板。当然,作为安全措施,我确实事先检查过PCB制造规格。但是,似乎他们对于1盎司有不同的规格。铜的厚度。

我设法使用以下方法纠正了所有(大约4000个净值)的轨道宽度"Find Similar Objects"和PCB Inspector只需单击几下,但是我可以't找出如何校正轨道之间的间隙。


除了手动单击每个轨道并重新放置它们之外,是否有其他方法可以(自动)校正轨道之间的间隙? (这几乎需要重新设计整个电路板。我不能在该电路板上使用自动布线)。


感谢您阅读此问题。
 

离线 马歇尔

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回复:如何自动更正多个违规行为?
« 在以下方面回复#1: 2013年8月30日,上午04:20:12»
如果您缺少音轨间间隙,并且有很多相邻音轨,那么您'我必须重新布置电路板的那些部分。
您可以尝试更改该间隙的设计规则,并进行轨道选择+ Ctrl拖动以一次在一组轨道上移动。

如果需要花费时间来修复它,也许可以再找一家可以做更严格规格的晶圆厂。每板支付更多,但可以节省工作。
Verilog提示
BGA焊接简介

11:37<@ktemkin>c4757p:马歇尔已经超越了通讯媒体
11:37<@ktemkin>他直接说协议。
 

离线 尼莫

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回复:如何自动更正多个违规行为?
« 在以下问题上回复#2: 2013年8月30日,下午06:32:29»
我期望针对这种问题会有某种脚本,但我想没有。

目前,由于多种原因,我无法切换到其他晶圆厂。因此,我唯一的选择是手动重新路由所有路由(整夜的工作需要几天  :'()


感谢您的帮助。
 

离线 Sacherjj

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回复:如何自动更正多个违规行为?
« 在以下方面回复#3: 2013年9月4日,下午05:16:53»
如果稍作调整,您也许可以将它们拉到间隙。 您将迹线拉入3个手柄之间,并向侧面滑动。  I'我发现我可以稍稍移动一点点。
 


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